Intel XBM: Neue Speichertechnologie für KI-Anforderungen
Veröffentlicht: 07.07.2026 um 13:17 Uhr, Redaktion boerse-global.de
Intel will mit einer neuartigen Speichertechnologie namens Cross-Batch Memory (XBM) die wachsenden Datenanforderungen Künstlicher Intelligenz bewältigen. Die zwischen dem 5. und 7. Juli 2026 veröffentlichten Patentanmeldungen zeigen einen radikalen Bruch mit etablierten Standards.
Technische Neuerungen im Detail
Das XBM-Design verzichtet auf den sogenannten Silizium-Interposer – ein Bauteil, das bei herkömmlichem High Bandwidth Memory (HBM) für hohe Kosten und Komplexität sorgt. Stattdessen setzt Intel auf einen Backend-Transistor-DRAM-Stack, der über Universal Chiplet Interconnect Express (UCIe) kommuniziert. Die Architektur soll Übertragungsraten von 32 GT/s erreichen.
Die Speicherzellen nutzen 1T1C-Transistoren (ein Transistor, ein Kondensator), die direkt in der rückseitigen Metallisierungsebene (BEOL) gefertigt werden. Dadurch rückt der Speicher näher an die Recheneinheiten – ein entscheidender Vorteil, denn der Datentransport zwischen Prozessor und Speicher gilt als größter Flaschenhals bei KI-Anwendungen.
Die Kapazität pro Die liegt zwischen 0,5 und 5,0 Gigabyte. Bis zu 16 dieser Einheiten lassen sich stapeln, was maximal 192 Datenblöcke ergibt. Für die Fertigung setzt Intel auf seine etablierten Packaging-Technologien Foveros und EMIB (Embedded Multi-die Interconnect Bridge). Integrierte Reparaturmechanismen sollen die Ausbeute bei der Produktion verbessern.
Konkurrenz für HBM4 und HBM4E
Intel positioniert XBM als direkten Wettbewerber zu den kommenden HBM-Generationen. Branchenbeobachter sehen die Technologie als mögliche Ergänzung oder sogar als vollwertigen Ersatz für HBM in bestimmten Hochleistungsanwendungen.
Die Ankündigung kommt zu einem Zeitpunkt, an dem die etablierten Speicherhersteller ihre eigenen Pläne vorantreiben. Erst am 6. Juli 2026 gab SK hynix bekannt, erste Muster des 12-lagigen HBM4E auszuliefern. Die Module bieten 48 Gigabyte Kapazität und 16 Gbit/s pro Pin bei verbesserter Energieeffizienz.
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Gleichzeitig zeichnet sich ab, dass Samsung und SK hynix den Einsatz von Hybrid Bonding für HBM4 möglicherweise verschieben. Grund sind gelockerte Dickenstandards von JEDEC, die den Herstellern erlauben, bewährte Packaging-Techniken eine weitere Generation zu nutzen. Der Umstieg auf Hybrid Bonding wäre dann erst für HBM5 oder HBM5E geplant.
Milliardenschwere Investitionen weltweit
Der Wettlauf um die Speicherhoheit für KI treibt gewaltige Investitionen an. Am 4. Juli 2026 feierte Micron den Spatenstich für eine 9,2 Milliarden Euro teure Erweiterung seines Werks im japanischen Hiroshima. Die japanische Regierung unterstützt das Projekt mit erheblichen Subventionen. Die ersten HBM-Chips sollen im Sommer 2028 ausgeliefert werden.
In Südkorea treiben Samsung und SK hynix Pläne für vier neue Fabriken mit einem Gesamtvolumen von über 500 Milliarden Euro voran. Derweil verschieben sich die Marktanteile: Der chinesische Hersteller CXMT steigerte seinen globalen DRAM-Anteil im ersten Quartal 2026 von drei auf acht Prozent.
Kommerzialisierung erst ab 2030
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Trotz der vielversprechenden technischen Grundlagen ist eine schnelle Markteinführung nicht zu erwarten. Intel peilt eine kommerzielle Verfügbarkeit von XBM frühestens 2030 an. Bis dahin setzen andere Hersteller auf alternative Wege: AMD etwa integriert LPDDR5X direkt in adaptive System-on-Chips, um die Grundfläche für Industrieanwendungen zu reduzieren.
Die Nachfrage nach schnellem, hochdichtem Speicher wächst rasant – allein im ersten Halbjahr 2026 flossen 510 Milliarden Euro in KI-Startups weltweit. Intels XBM-Patent ist ein langfristiger strategischer Versuch, in einem Ökosystem Fuß zu fassen, das derzeit von wenigen spezialisierten DRAM-Herstellern dominiert wird.
